Noch Fragen? 0800 / 33 82 637

Verilog

Modellbildung für Synthese und Verifikation

Produktform: Buch / Einband - fest (Hardcover)

Verilog ist die neben VHDL am weitesten verbreitete Hardware-Beschreibungssprache (HDL) für den Entwurf und die Beschreibung elektronischer Schaltkreise und Systeme. Gegenüber VHDL bietet Verilog vor allem den Vorteil der leichteren Erlernbarkeit, da es auf der im Ingenieurbereich weit verbreiteten Sprache C aufgebaut ist. Das Buch von Bernhard Hoppe vermittelt alle relevanten Grundlagen und Anwendungsmöglichkeiten von Verilog und ermöglicht so einen schnellen Einstieg und Überblick. Es ist konzipiert als Lehrbuch für Studierende der Elektrotechnik im Hauptstudium, eignet sich aber auch zum Selbststudium für Berufspraktiker und andere Interessierte. Jedes Kapitel enthält Übungsaufgaben mit Lösungen; dem Buch ist eine CD mit Powerpoint-Folien für den Unterricht, einer Laboranleitung mit Zugang zu der XILINX Studentenversion für den Simulator MODELSIM und Quellcodes beigelegt.weiterlesen

Dieser Artikel gehört zu den folgenden Serien

Sprache(n): Deutsch

ISBN: 978-3-486-58004-4 / 978-3486580044 / 9783486580044

Verlag: De Gruyter Oldenbourg

Erscheinungsdatum: 20.09.2006

Seiten: 302

Auflage: 1

Autor(en): Bernhard Hoppe

54,95 € inkl. MwSt.
List Price
kostenloser Versand

sofort lieferbar - Lieferzeit 1-3 Werktage

zurück